The S5 Series offers 64-bit RISC-V performance with 32-bit power and area
适用于高端 4G/5G 和大型 MIMO 应用的软件无线电
这个平台可用于建立具有4x4 MIMO和信道带宽超过60 MHz的应用.
这个平台通过LTE eNB和UE应用演示了该平台的功能,并且提供了发送和接收IQ样本向量的应用实例.
开发环境 -
SOC上的DSP是用德州仪器的IDE Code Composer Studio编程的。
ARM Cortex A15内核是在GCC编译器的帮助下进行编程的。
FPGA代码是使用Xlinx公司的Vivado工具开发的。
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SDR IP
- Software Defined Radio for High Throughput PTP and PTMP network communication
- Software Defined Radio with Spread spectrum and SOQPSK for Telemetry applications
- 1st Generation Software Defined Radio RF IP
- 2nd Generation Software Defined Radio RF IP
- MIPI-I3C HOST (SDR)
- Complete memory system supporting any combinations of SDR SDRAM, DDR, DDR2, Mobile SDR, FCRAM, Flash, EEPROM, SRAM and NAND Flash, all in one IP core