768x39 Bits OTP (One-Time Programmable) IP, TSMC 55ULP 0.9V–1.2V / 2.5V
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MIPI D-PHY Tx IP，在 TSMC 22ULP 中经过硅验证
MIPI D-PHY模拟TX IP完全符合 D-PHY v1.2规范，支持MIPI Camera串行接口（CSI-2）和显示串行接口(DSI协议）。这个TX PHY IP有1个时钟通道和4个数据通道,其中模拟前端用于生成和接收电水平信号和数字后端用于控制I/O功能。内部终端电阻具有自动校准功能-PHY是一个MIPI DSI PHY（MIPI TX DPHY）包括一个PLL，一个时钟通道和四个数据通道，用于MIPI DSI数据传输，同时D-PHY可以作为一个5V容差的GPIO库。
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Block Diagram of the MIPI D-PHY Tx IP，在 TSMC 22ULP 中经过硅验证
DPHY IP in TSMC IP
- MIPI D-PHY in TSMC (40nm, 28nm, 16nm, 12nm, 7nm)
- MIPI D-PHY IP for TSMC (5nm, 6/7nm, 12/16nm, 22nm, 28nm, 40nm)
- MIPI D-PHY / C-PHY Combo IP for TSMC (5nm, 6/7nm, 12/16nm, 22nm, 28nm, 40nm)
- MIPI C-PHY/D-PHY Combo RX+ IP 4.5Gsps/4.5Gbps in TSMC N5
- MIPI C-PHY/D-PHY Combo CSI-2 RX+ IP (6.0Gsps/trio, 4.5Gbps/lane) in TSMC N6
- MIPI C-PHY/D-PHY Combo TX+ IP 4.5Gsps/4.5Gbps in TSMC N5