Scalable, On-Die Voltage Regulation for High Current Applications
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LVDS Rx IP，在 GF 28LPe 中经过硅验证
这个用于LVDS接收器的物理层IP，由20车道（4 x 4D1C）LVDS接收器组成，并支持高达1.5Gbps的数据速率。这个IP的输入时钟为25MHz到150MHz，其序列化器高度集成功能完善，不需要添加外部元件。这个IP的电路以模块化的方式设计，并对处理变化进行了脱敏处理，促进了过程迁移，使这个设计非常稳定。
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Block Diagram of the LVDS Rx IP，在 GF 28LPe 中经过硅验证
