MIPI D-PHY IP for TSMC (5nm, 6/7nm, 12/16nm, 22nm, 28nm, 40nm)
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DDR4/ LPDDR4/ DDR3L PHY IP - 3200Mbps（在 TSMC 12FFC 中经过硅验证）
DDR4/DDR3L/LPDDR4 Combo PHY IP设计的延迟性降低，支持高达3200Mbps的吞吐量。PHY IP符合最新JEDEC标准，已经在TSMC 12FFC工艺技术中得到了硅验证。它的设计容易被集成在芯片中，缩短了开发时间，利于加快上市周期。
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