MIPI C-PHY v1.2 D-PHY v2.1 TX 3 trios/4 Lanes in TSMC (16nm, N7, N5A)
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VPU R3.0 on Artix 7 100T
视频处理器IP
视频处理器IP是一款适用于高速、高分辨率视频系统的视频处理系统. 目前可支持HDMI全高清（1920x1080p）输入输出接口，可用于各种视频处理和视频传输应用。视频处理器IP 是能够在 60 fps (16.67 ms) 内执行多种视频处理算法。这条高速功能允许IP进行视频边缘增强和实时全速视频锐化。
视频处理器IP 以综合后网表形式提供，目前支持 Xilinx FPGA设备。下面的“功能”部分列出了一些核心功能和优势。
视频处理器IP是一款适用于高速、高分辨率视频系统的视频处理系统. 目前可支持HDMI全高清（1920x1080p）输入输出接口，可用于各种视频处理和视频传输应用。视频处理器IP 是能够在 60 fps (16.67 ms) 内执行多种视频处理算法。这条高速功能允许IP进行视频边缘增强和实时全速视频锐化。
视频处理器IP 以综合后网表形式提供，目前支持 Xilinx FPGA设备。下面的“功能”部分列出了一些核心功能和优势。
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Block Diagram of the VPU R3.0 on Artix 7 100T
Video Demo of the VPU R3.0 on Artix 7 100T
This is V1.0 demo. This V3.0 has additional features, including AXI4-Stream support, user configurable settings and better example design.