PCIe 4.0 Serdes PHY IP，在 UMC 28HPC 中经过硅验证

这个PCIE 4.0 SERDES PHY IP符合PIPE 4.4接口规范，外围组件互连快速（PCIe）PHY Gen4 PHY IP符合PCIe 4.0基本规范,提供额外的PLL控制、参考时钟控制和内置电源门控来降低功耗。此外，低功耗模式可进行客制化设计，这个PHY IP广泛适用于具有不同功耗限制的各种场景.

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