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PCIe 4.0 Serdes PHY IP，在 TSMC 12FFC 中经过硅验证
PCIe 4.0 Serdes PHY IP符合 PCIe 4.0 基本规范，支持 PIPE 4.4 接口规范。 该设计能另外接受PLL 控制、参考时钟控制和内置式电源门控，从而降低功耗。此外，由于低功耗模式是可以配置的，因此该设计可被广泛用于不同功耗需求的各种场景。
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Block Diagram of the PCIe 4.0 Serdes PHY IP，在 TSMC 12FFC 中经过硅验证
PCIeIP IP
- PCIe 5.0 Serdes PHY IP, Silicon Proven in TSMC 12FFC
- PCIe 3.0 Serdes PHY IP, Silicon Proven in TSMC 28HPCP
- PCIe 3.1 Serdes PHY IP, Silicon Proven in TSMC 28HPCP
- PCIe 3.0 Serdes PHY IP, Silicon Proven in UMC 28HPC
- PCIe 3.0 Serdes PHY IP, Silicon Proven in UMC 40LP
- PCIe 3.0 Serdes PHY IP, Silicon Proven in UMC 55SP