You are here:
PCIe 3.0 Serdes PHY IP，在 TSMC 22ULP 中经过硅验证
pcie3.0phyip的低功耗、多通道、高性能设计旨在支持更多的应用。它完全支持广泛的pcie3.0基础应用，并符合管道4.3规范。通过集成高速混合信号电路，IP实现了8GBPS的pcie3.0流量。它与pcie2.0的5.0gbps和pcie1.0的2.5gbps的传输吞吐量保持向后兼容性。此外，它通过支持TX和RX均衡方法来适应各种信道情况。
查看 PCIe 3.0 Serdes PHY IP，在 TSMC 22ULP 中经过硅验证 详细介绍：
- 查看 PCIe 3.0 Serdes PHY IP，在 TSMC 22ULP 中经过硅验证 完整数据手册
- 联系 PCIe 3.0 Serdes PHY IP，在 TSMC 22ULP 中经过硅验证 供应商
Block Diagram of the PCIe 3.0 Serdes PHY IP，在 TSMC 22ULP 中经过硅验证
PCIe3 IP
- Multi-protocol SerDes PMA - PCIe1 PCIe2 PCIe3 PCIe4 PCIe5 and more
- Multi-protocol SerDes PMA in FDSOI (GF22FDX FDX 22FDX) - PCIe1 PCIe2 PCIe3 PCIe4 and more
- Low Power PCIe3 SERDES PHY - TSMC 40G
- Low Power PCIe3/SATA3SERDES PHY - TSMC 28HPC+
- Low Power PCIe3/SATA3 SERDES PHY - TSMC 16FFC
- Low Power PCIe3/SATA3 SERDES PHY - TSMC 12FFC