MIPI C-PHY v1.2 D-PHY v2.1 TX 3 trios/4 Lanes in TSMC (16nm, N7, N5A)
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低功耗高速 1.2GHz Frac-N PLL IP 核
这个1.2GHz频率的可编程即时分数-N锁相环（PLL）采用40纳米工艺生成输出时钟并同步输入时钟源。
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