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JESD204A IP核
JEDEC标准编号204A (JESD204A)阐述了数据转换器和逻辑器件之间的串行接口。它包含了设计师实现器件与其他符合该标准的器件进行通信所需的信息。Lattice的JESD204A IP核同时支持Rx核（ADC到FPGA方向）和/或Tx核（FPGA到DAC方向）。RX和TX内核可以单独生成，并使用不同的参数。
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Block Diagram of the JESD204A IP核
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