55nmHV MTP Non Volatile Memory for Standard CMOS Logic Process
DDR SDRAM控制器 - 非流水线技术
DDR SDRAM控制器是一个参数可配置的核,让用户可以灵活地修改设计的数据宽度、突发传输速率和CAS延迟时间设置。此外,DDR核支持智能bank管理,通过维护一个''所有激活的bank"的数据库来实现。有了这个信息,DDR SDRAM控制器可以决定是否需要active或pre-charge指令。这将有效降低发送到DDR SDRAM读/写指令的延迟。
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