Original Lossless codec IP core - Full HD 30fps@126MHz (1Sample/clk)
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2D图像缩放IP核
2D图像缩放IP核将一种输入视频帧大小转换成另一种输出视频帧大小。其灵活的架构支持各种缩放比例的算法。高度可配置的设计利用了莱迪思FPGA中的嵌入式DSP块。简单的I/O握手协议使得内核适用于视频流或者突发的输入视频数据处理。可按每帧对在系统输入和输出帧大小进行更新。
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Block Diagram of the 2D图像缩放IP核
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