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2D FIR 滤波器IP核
二维FIR滤波器IP核能够实施输入视频帧的窗口部分的实时二维卷积，系数矩阵存储在内部存储器中。其灵活的架构支持各种用莱迪思器件系列的多种滤波运算。高度参数化的设计利用了莱迪思FPGA中的嵌入式DSP块。一个简单的I / O握手信号使得该核适合流或突发的输入视频数据。系数可在编译时设置，或通过一个简单的存储器接口在系统中更新。
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Block Diagram of the 2D FIR 滤波器IP核
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