2-stage Power Amplifier 28GHz ultra-efficient Dual-Drive™ PA
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14 位、4.32Gsps 超高速宽带、时间交错流水线 ADC IP
这个超高速宽带模拟数字转换器基于16个时间交错的流水线子ADC，后接数字校正算法，用于增益、偏移和失调的校正。这个ADC IP的差分输入端由100欧姆电阻（100欧姆差分）终端，之后接入一个驱动子ADC的输入缓冲器。这个ADC IP的信号幅度为1Vpp差分。驱动ADC的模拟信号源应该通过两个最小容量为1nF的外部电容与输入引脚进行交流耦合。输入共模由内部生成。
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Block Diagram of the 14 位、4.32Gsps 超高速宽带、时间交错流水线 ADC IP
14-bit IP
- 14-bit, 8 GSPS IQ DAC Ultra Low Power on GF 22FDX
- 14-Bit 150MS/s 1.2V/3.3V 250mW ADC, CMOS 130nm
- 14-bit, 2.4 GSPS High Performance Swift™ DAC in 16nm CMOS
- 14-bit, 1200 MSPS Ultra Low Power ADC in 28nm CMOS
- 14-bit, 1200 MSPS Ultra Low Power AFE in 28nm CMOS
- 14-bit, 50 MSPS Ultra Low Power ADC in 28nm CMOS